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樊明;
湖南大学;
Serdes; 系统; 高速; 振荡器; 分频器;
机译:与FPD Link III Serdes的通信:具有高速数据电缆的系统设计
机译:使用250nm Cmos技术在PLL系统中实现1.8 Ghz-2.4 Ghz完全可编程分频器和双模预分频器,以在PLL系统中实现高速频率工作
机译:微波模拟分频器的相位噪声性能:应用于表征毫米波范围的振荡器
机译:基于机器学习的设计空间探索和应用于112GB Serdes系统的Initional Integrity分析
机译:低功耗模拟前端设计112 Gbps PAM-4 Serdes接收器
机译:通过阶段响应功能设计提高脉冲耦合振荡器的同步速率:理论和应用于无线网络
机译:高速Serdes系统级优化:背景和朝向机器学习辅助设计框架的道路
机译:用于高温操作的晶体振荡器和分频器的评估
机译:半导体设计中高速SERDES内核的选择性测试点
机译:无延迟的开关振荡器将主振荡器的输出频率馈入分频器,该分频器的输出信号可以通过关闭分频器来关闭
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