adder; carry chain; counter; design for testability; lookup table; scan register; universal shift register;
机译:用于数据挖掘的多字母算术编码的整数实现的高效硬件体系结构
机译:采用FDFM处理器核心方法的柔性长度算法处理器的FPGA实现
机译:使用分布式算术的高速和面积高效FPGA实现FIR滤波器
机译:在FPGA的整数运算核心上高效实现扫描寄存器插入
机译:基于SRAM的FPGA中实现的软核处理器的硬件和软件容错
机译:用于视频压缩的最佳3D整数DCT结构的FPGA实现
机译:FpGa上高速Dsp实现的高效算法