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【24h】

フロアプランベース物理合成によるレイアウト問題の早期解決

机译:通过基于平面图的物理综合来早期解决布局问题

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摘要

ASIC 開発において,製造プロセスの微細化に伴い,配線の遅延時間が支配的になっている.RTL 設計段階で行うワイヤロードモデルの論理合成(以下論理合成)ではレイアウト結果と配線遅延がかけ離れてしまうため,物理情報ベースの論理合成(以下物理合成)が主流となっているが,論理合成や物理合成等の従来手法でも検出できないタイミング違反がレイアウト工程で表れるようになり大きな設計手戻りを引き起こす要因となっている.
机译:在ASIC开发中,随着制造过程的小型化,分销 线路延迟时间占主导地位。在RTL设计阶段执行 在线负载模型的逻辑综合(以下简称逻辑综合)中,层 由于结果和布线延迟相距甚远,因此物理信息库 逻辑综合(以下简称物理综合)是主流,但理论 不能通过物理合成和物理合成等常规方法检测到的泰民 在布局过程中,违规行为已变得显而易见,这使其成为一名大型设计师。 这是导致回报的因素。

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