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CMOS Device Architecture and Technology for the 0.25 Micron to 0.025 Micron Generations

机译：0.25微米至0.025微米的CMOS器件架构和技术

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来源
《Solid State Device Research Conference, 1993. ESSDERC '93》|1993年|513-520|共8页
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作者
Iwai Hiroshi;
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正文语种
中图分类非金属材料;
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1. Total-dose and SEU characterization of 0.25 micron CMOS/SOI integrated circuit memory technologies [J] . Brothers C., Pugh R. IEEE Transactions on Nuclear Science . 1997,第6期

机译：0.25微米CMOS / SOI集成电路存储技术的总剂量和SEU表征
2. Low-resistance self-aligned Ti-silicide technology for sub-quarter micron CMOS devices [J] . Mogami T., Wakabayashi H. IEEE Transactions on Electron Devices . 1996,第6期

机译：适用于四分之一微米以下CMOS器件的低电阻自对准钛硅化物技术
3. Design of 900 Mhz AC to DC Converter Using Native Cmos Device of TSMC 0.18 Micron Technology for RF Energy Harvest Application [J] . Angelo N. Rodriguez, Febus Reidj G. Cruz, Ronnie Z. Ramos Universal Journal of Electrical and Electronic Engineering . 2015,第3期

机译：使用台积电0.18微米技术的原生Cmos器件设计900 Mhz交流到直流转换器，用于射频能量收集应用
4. Advanced wiring RC delay issues for sub-0.25-micron generation CMOS [C] . Stamper A.K., Fuselier M.B., Tian X. Interconnect Technology Conference, 1998. Proceedings of the IEEE 1998 International . 1998

机译：0.25微米以下CMOS的高级布线RC延迟问题
5. A mixed-signal feed-forward neural network architecture with on-chip learning in CMOS 0.18 microns. [D] . Mirhassani, Mitra. 2003

机译：一种混合信号前馈神经网络体系结构，具有CMOS 0.18微米的片上学习功能。
6. Standard of Spectral Radiance for the Region of 0.25 to 2.6 Microns [O] . Ralph Stair, Russell G. Johnston, E. W. Halbach 1960

机译：0.25至2.6微米区域的光谱辐射标准
7. Switching Response Modeling of the CMOS Inverter for Sub-micron Devices [O] . L. Bisdounis, S. Nikolaidis, O. Koufopavlou, 2015

机译：用于亚微米器件的CmOs逆变器的开关响应建模

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