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【24h】

メタヒューリスティックに基づくタイミング制約を考慮したフロアプランニング手法

机译:基于元启发式的考虑时序约束的楼层规划方法

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摘要

半導体技術の進歩により,VLSIレイアウト設計におけるパフォーマンスの考慮の重要性が益々增大している.このようなディープサプミクロンULSIチップにおいては回路遅延全体に占める配線遅延の割合が支配的となるため,機能論理設計における回路の短縮だけでは対処できず,配線遅延を考慮したレイアウト設計手法が不可欠となる.ではタイミング制約が与えられたビルデインググロックレイアウトに対するフロアプランニング手法に注目し,フロアプラン,およびバッファ挿入と配線幅調整を考慮した概略配線を同時に求める手法を提案する.
机译:半导体技术的进步使得在VLSI布局设计中考虑性能变得越来越重要,在这种深超微米级的ULSI芯片中,布线延迟与总电路延迟之比成为主要问题,因此功能逻辑不可能只进行处理。通过缩短设计中的电路,考虑布线延迟的布局设计方法是必不可少的,我们提出了一种在考虑宽度调整的同时获得近似布线的方法。

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