Microelectronics Center, Harbin Institute of Technology, 150001, Harbin, China;
机译:同步逻辑综合:周期时间最小化的算法
机译:使用遗传和启发式算法进行Baldwinian学习,以广义Reed-Muller(AND-EXOR)形式进行逻辑综合和不完全指定数据的最小化
机译:使用外围重定时和重新合成优化流水线逻辑电路的性能
机译:一种新的重定时算法,用于同步逻辑综合中的周期时间最小化
机译:重新计时,折叠和寄存器最小化,以实现DSP综合。
机译:永磁同步电动机(PMSM)中周期性转矩脉动最小化的新的自适应自调谐傅里叶系数算法
机译:同步逻辑综合:循环时间最小化算法
机译:Dsp合成的重定时,折叠和寄存器最小化。