CMOS integrated circuits; codecs; cyclic codes; parity check codes; shift registers; CMOS technology; decoder architecture; feedback shift-registers; microwave radio systems; min-sum algorithm; quasi-cyclic low-density parity-check codes; size 0.15 mum; voltage 1.5;
机译:高速率长QC-LDPC码的设计与实现及其在光传输系统中的应用
机译:联合迭代解码的编码合作系统QC-LDPC码的联合设计
机译:OCDMA系统中利用差分检测的新型编码器/解码器设计方案
机译:微波无线电系统的高速QC-LDPC编码器/解码器设计
机译:适用于5G无线的高吞吐量FPGA QC-1DPC解码器架构。
机译:可以解码和擦除的数字编码聚合物的设计和合成
机译:用联合迭代译码编码协作系统的QC-LDpC码的联合设计