A 14b 100MS/s 3.4mm2 145mW 0.18um CMOS Pipeline A/D Converter

机译：一个14b 100MS / s 3.4mm2 145mW 0.18um CMOS流水线A / D转换器

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This work proposes a 14b 100MS/s 0.18mum CMOS ADC for the fourth-generation mobile communication systems. The proposed 3-stage pipeline ADC, whose architecture is verified with behavioral model simulations, employs a wide-band low-noise SHA to achieve a 1

机译：这项工作为第四代移动通信系统提出了14b 100MS / s 0.18mum CMOS ADC。拟议的三级流水线ADC，其架构已通过行为模型仿真进行了验证，它采用宽带低噪声SHA来实现1

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来源
《Circuits and Systems, (APCCAS), 2006 IEEE Asia Pacific Conference on》|2006年|P.351-354|共4页
会议地点 Singapore
作者
Kyung-Hoon Lee; Young-Jae Cho; Hee-Cheol Choi; Yong-Hyun Park; Doo-Hwan Sa; Young-Lok Kim; Seung-Hoon Lee;
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作者单位

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会议组织
原文格式 PDF
正文语种
中图分类
关键词
CMOS integrated circuits; analogue-digital conversion; integrated circuit modelling; low noise amplifiers; sample and hold circuits; wideband amplifiers; 0.18 micron; 1.8 V; 145 mW; 3D fully symmetric layout; A/D converter; CMOS pipeline; ENOB; MDAC; Nyquist input fre;

机译：CMOS集成电路；模数转换；集成电路建模；低噪声放大器；采样和保持电路；宽带放大器； 0.18微米； 1.8伏; 145兆瓦; 3D全对称布局； A / D转换器； CMOS流水线； ENOB; MDAC;奈奎斯特输入频率;

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