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基于改进的布斯算法FPGA嵌入式18×18乘法器

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本文设计了一款嵌入到FPGA的乘法器,提出了一种新的布斯译码和部分积结构,并对9-2压缩树和超前进位加法器进行了优化。

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来源
《四川省电子学会2009年学术年会》|2009年|187-188|共2页
会议地点成都
作者
王鲁豫; 杨志明; 黄国辉; 曾波;
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作者单位

中国电子学会;

四川省电子学会;

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会议组织
正文语种
原文格式 PDF
中图分类设计;
关键词
集成电路; 乘法运算器; 芯片设计; 布斯算法;
入库时间 2022-08-17 10:49:04

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