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VITERBI ACS UNIT WITH RENORMALIZATION

机译:重新标准化的VITERBI ACS单元

摘要

In a Viterbi decoder including an add-compare-select (ACS) processor (ACS0, ACS1,... ACS63), speed is enhanced without loss of performance by maintaining a dynamic cumulative metric range for computed metrics to obtain two computed metrics, and the smaller of the two computed metrics is stored along with previously computed state metrics. In the renormalization circuit (RENORM), the stored state metrics are compared with a selected scale factor, for example one-half maximum scale factor, and all current state metrics are rescaled when the minimum stored metric value exceeds the selected scale factor.
机译:在包括加比较选择(ACS)处理器(ACS0,ACS1,... ACS63)的Viterbi解码器中,通过为计算量度保持动态累积量度范围以获得两个计算量度,来提高速度而不会损失性能。两个计算的指标中较小的一个与先前计算的状态指标一起存储。在重归一化电路(RENORM)中,将存储的状态度量与选定的比例因子(例如最大比例因子的一半)进行比较,并在最小存储的度量值超过所选的比例因子时重新缩放所有当前状态度量。

著录项

  • 公开/公告号WO9602973A1

    专利类型

  • 公开/公告日1996-02-01

    原文格式PDF

  • 申请/专利权人 STANFORD TELECOMMUNICATIONS INC.;

    申请/专利号WO1994US07957

  • 发明设计人 NGUYEN CHRISTINE;GRAHAM HATCH;

    申请日1994-07-15

  • 分类号H03D1/00;G06F11/10;H03M13/00;H04L5/12;H04L23/02;H04L27/06;

  • 国家 WO

  • 入库时间 2022-08-22 03:49:09

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