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BUS INTERFACE SYSTEM, INTEGRATED CIRCUIT DEVICE, AND BUS INTERFACE METHOD

机译:总线接口系统,集成电路装置和总线接口方法

摘要

PROBLEM TO BE SOLVED: To provide a bus interface system, integrated circuit device, and bus interface method which can make data transfer between systems fast. ;SOLUTION: An opposite system 10 outputs bus data 96 by using a bus clock 92 supplied from its own system 20. A 1st buffer 32 buffers an internal clock 90 and outputs a bus clock 92 to the opposite system 10, a 2nd buffer 34 buffers the bus clock 92 and outputs a fetch clock 94 to a DFF 38, and a 3rd buffer 36 buffers the bus data 96 and outputs fetch data 98 to the DFF 38. The DFF 38 fetches the fetch data 98 by using the fetch clock 94. Consequently, the setup time of the DFF 38 can be optimized. Buffers includes in an input and buffer cell are preferably the 1st buffer 32 and 2nd buffer 34.;COPYRIGHT: (C)1997,JPO
机译:要解决的问题:提供一种总线接口系统,集成电路器件和总线接口方法,可以使系统之间的数据传输更快。解决方案:对立系统10使用从其自身系统20提供的总线时钟92输出总线数据96。第一缓冲器32缓冲内部时钟90,并将总线时钟92输出至对立系统10,第二缓冲器34缓冲总线时钟92,将提取时钟94输出到DF​​F 38,第三缓冲器36缓存总线数据96,并且将提取数据98输出到DF​​F38。DFF38通过使用提取时钟94来提取提取数据98。因此,可以优化DFF 38的建立时间。输入和缓冲单元中包括的缓冲器最好是第一缓冲器32和第二缓冲器34 。;版权:(C)1997,JPO

著录项

  • 公开/公告号JPH0962619A

    专利类型

  • 公开/公告日1997-03-07

    原文格式PDF

  • 申请/专利权人 NAMCO LTD;

    申请/专利号JP19950243707

  • 申请日1995-08-29

  • 分类号G06F13/42;G06F3/00;G06F13/16;

  • 国家 JP

  • 入库时间 2022-08-22 03:31:25

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