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Cache memory system and method utilizing doubly-linked loop of cache lines and a single pointer to address a cache line in the doubly-linked loop

机译:高速缓冲存储器系统和方法,其利用高速缓冲存储器线的双向链接循环和单个指针来寻址双向链接循环中的高速缓存行

摘要

An improved cache memory and method of operation thereof. The cache memory includes a doubly-linked loop of cache lines and a single pointer operable to address a cache line in the doubly-linked loop. In the cache memory, the pointer is preferably operable to address a next cache line in the doubly-linked loop, or a previous cache line in the doubly-linked loop. The cache memory as described permits a reduction in the number of instruction steps involved in controlling the cache lines. The improved cache memory may be implemented in a data processing system or within a computer program product.
机译:改进的高速缓冲存储器及其操作方法。高速缓冲存储器包括高速缓存线的双链接环和可操作以在双链接环中寻址高速缓存线的单个指针。在高速缓冲存储器中,指针优选地可操作以寻址双链接循环中的下一个高速缓存行,或双链接循环中的前一个高速缓存行。所描述的高速缓冲存储器允许减少控制高速缓存行所涉及的指令步骤的数量。改进的高速缓冲存储器可以在数据处理系统中或在计算机程序产品内实现。

著录项

  • 公开/公告号US6467025B1

    专利类型

  • 公开/公告日2002-10-15

    原文格式PDF

  • 申请/专利权人 INTERNATIONAL BUSINESS MACHINES CORPORATION;

    申请/专利号US20000519344

  • 发明设计人 JAMES LEIGH TAYLOR;

    申请日2000-03-06

  • 分类号G06F121/00;

  • 国家 US

  • 入库时间 2022-08-22 00:49:11

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