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Cache memory system, a cache memory, an updating method for the cache memory and for the cache memory system, and an updating program for the cache memory system

机译:高速缓冲存储器系统,高速缓冲存储器,用于高速缓冲存储器和高速缓冲存储器系统的更新方法以及用于高速缓冲存储器系统的更新程序

摘要

A cache memory system includes a cache memory having a plurality of entries. Each entry configured to include each of information storage units fetching and storing part of information stored in a main memory. Each of reference bit storage units stores a use status for a certain period of information stored in the corresponding information storage unit. A hit detection circuit is connected to the information storage units. The hit detection circuit generates a hit signal to each of the reference bit storage units.
机译:高速缓冲存储器系统包括具有多个条目的高速缓冲存储器。每个条目被配置为包括每个信息存储单元,以获取并存储存储在主存储器中的部分信息。每个参考位存储单元存储在相应信息存储单元中存储的信息的特定时段的使用状态。命中检测电路连接到信息存储单元。命中检测电路产生一个命中信号给每个参考位存储单元。

著录项

  • 公开/公告号US2004181633A1

    专利类型

  • 公开/公告日2004-09-16

    原文格式PDF

  • 申请/专利权人 KABUSHIKI KAISHA TOSHIBA;

    申请/专利号US20030449108

  • 发明设计人 TETSUHIKO AZUMA;

    申请日2003-06-02

  • 分类号G06F12/00;

  • 国家 US

  • 入库时间 2022-08-21 23:22:21

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