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Test pattern creation manner of system LSI, being the manner which creates the test pattern in order to test each function

机译:系统LSI的测试模式创建方式,是为了测试各功能而创建测试模式的方式

摘要

PROBLEM TO BE SOLVED: To provide a test pattern creation method, a test pattern creation device, a test method and a test circuit for shortening a test time of a functional circuit block (IP) on a system LSI.;SOLUTION: This test pattern creation method creates a test pattern for testing each function of a plurality of functional circuit blocks integrated on the system LSI. The method is characterized by shortening the total test time by using a parallel access technique, a serial access technique, and additionally a parallel/serial mixed access technique, if necessary, combinationally to each IP, and by reducing an unused region of an LSI pin. This test method created in this way is also provided.;COPYRIGHT: (C)2003,JPO
机译:解决的问题:提供一种用于缩短系统LSI上的功能电路块(IP)的测试时间的测试图案创建方法,测试图案创建设备,测试方法和测试电路;解决方案:该测试图案该创建方法创建用于测试集成在系统LSI上的多个功能电路块的每个功能的测试模式。该方法的特征在于,通过对每个IP组合使用并行访问技术,串行访问技术以及必要时还使用并行/串行混合访问技术来缩短总测试时间,并减少LSI引脚的未使用区域。还提供了以此方式创建的测试方法。版权所有:(C)2003,JPO

著录项

  • 公开/公告号JP3606520B2

    专利类型

  • 公开/公告日2005-01-05

    原文格式PDF

  • 申请/专利权人 沖電気工業株式会社;

    申请/专利号JP20010371925

  • 发明设计人 牛久保 政憲;

    申请日2001-12-05

  • 分类号G01R31/28;G01R31/3183;

  • 国家 JP

  • 入库时间 2022-08-21 22:26:27

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