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SUBSYSTEM MODULE, INFORMATION PROCESSOR, AND DATA TRANSFER METHOD IN THE SUBSYSTEM MODULE

机译:子系统模块中的子系统模块,信息处理器和数据传输方法

摘要

PPROBLEM TO BE SOLVED: To efficiently recover transfer errors in a bus access, and to enhance transfer accuracy. PSOLUTION: A bit for indicating the generation of a data parity error is formed in a control register 17, status of the parity error bit indicates the error, sequence number is written in an error status area of the control register 17, and the error is notified to a main board 5, when the data parity error is generated in a bus interface 14 in bus master thereof. Data, generating the transfer error, are thereby retransmitted to a subsystem module with respect to the sequence number written in the error status area of the control register 17, in a main board 5 side receiving error notification, and the transfer error in the bus access is recovered efficiently, thereby enhancing the transfer accuracy. PCOPYRIGHT: (C)2006,JPO&NCIPI
机译:

要解决的问题:有效地恢复总线访问中的传输错误,并提高传输精度。解决方案:在控制寄存器17中形成用于指示数据奇偶校验错误产生的位,奇偶校验错误位的状态指示错误,序列号被写入控制寄存器17的错误状态区域中,并且当在其总线主控器的总线接口14中产生数据奇偶校验错误时,将该错误通知给主板5。相对于写在控制寄存器17的错误状态区域中的顺序号,在产生错误的数据中,在接收到错误通知的主板5侧,以及总线访问中的错误,被重新发送到子系统模块。有效地回收了碳,从而提高了转印精度。

版权:(C)2006,JPO&NCIPI

著录项

  • 公开/公告号JP2006260273A

    专利类型

  • 公开/公告日2006-09-28

    原文格式PDF

  • 申请/专利权人 RICOH CO LTD;

    申请/专利号JP20050077878

  • 发明设计人 SOEJIMA MACHIKO;

    申请日2005-03-17

  • 分类号G06F13/00;G06F13/28;

  • 国家 JP

  • 入库时间 2022-08-21 21:54:59

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