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Method of designing a logic circuit utilizing an algorithm based in C language

机译:利用基于c语言的算法设计逻辑电路的方法

摘要

An algorithm C description describing an algorithm of computation or control of a logic circuit in a C language is split into a plurality of states in units of processing, and the execution order of the split processing is described as state transition, to generate a functional C description with a control description embedded therein. A clock description as the conception of time is inserted in the functional C description, to be converted into a RT level C description. The RT level C description is converted into a RT level description in HDL with an existing conversion tool.
机译:将以C语言描述逻辑电路的计算或控制算法的算法C描述以处理单位划分为多个状态,并将划分处理的执行顺序描述为状态转换,以生成功能C控件说明嵌入其中的说明。将作为时间概念的时钟描述插入功能C描述中,以转换为RT等级C描述。使用现有的转换工具,RT级别C描述将转换为HDL中的RT级别描述。

著录项

  • 公开/公告号US7062728B2

    专利类型

  • 公开/公告日2006-06-13

    原文格式PDF

  • 申请/专利权人 MASAYOSHI TOJIMA;

    申请/专利号US20020167579

  • 发明设计人 MASAYOSHI TOJIMA;

    申请日2002-06-13

  • 分类号G06F17/50;

  • 国家 US

  • 入库时间 2022-08-21 21:43:35

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