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Automatic test pattern generation for functionally register transfer level circuits with the allocation corresponding apparent to those skilled in the diagrams

机译:用于功能寄存器传输级电路的自动测试模式生成,其分配对图中的技术人员来说是显而易见的

摘要

Test patterns are generated by generating (105) assignment decision diagrams that represent a register transfer level digital circuit. A nine-valued symbolic algebra is used in which objectives are determined (107) for portions identified in the assignment decision diagram. The objectives are justified and propagated by traversing the assignment decision diagram in which a test environment is found (111). Heuristics are used (115) if a test environment is not initially found. Using the test environment found, predetermined test vectors are propagated (117) to obtain a system-level test set. Each test set for each portion is concatenated (123) to obtain a complete test set for the register transfer level digital circuit.
机译:通过产生(105)代表寄存器传输级数字电路的分配决策图来产生测试模式。使用九值符号代数,其中确定在分配决策图中标识的部分的目标(107)。通过遍历在其中找到测试环境的分配决策图来证明并传播目标(111)。如果最初没有找到测试环境,则使用启发式方法(115)。使用找到的测试环境,传播预定的测试矢量(117)以获得系统级测试集。连接每个部分的每个测试集(123)以获得用于寄存器传输级数字电路的完整测试集。

著录项

  • 公开/公告号DE60112998T2

    专利类型

  • 公开/公告日2006-02-23

    原文格式PDF

  • 申请/专利权人 FUJITSU LTD. KAWASAKI KANAGAWA JP;

    申请/专利号DE2001612998T

  • 发明设计人 GHOSH INDRADEEP SAN JOSE US;

    申请日0000-00-00

  • 分类号G01R31/3183;G06F11/263;

  • 国家 DE

  • 入库时间 2022-08-21 21:18:57

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