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Test circuit with physical layer device and test circuit with link layer device

机译:具有物理层设备的测试电路和具有链路层设备的测试电路

摘要

PROBLEM TO BE SOLVED: To provide a link layer device with testing circuit for eliminating usual inconvenience by enabling to measure the AC timing by a link layer device single body and enabling to measure by changing measuring conditions such as temperature and source voltage by using a general purpose board. SOLUTION: When a testing circuit 21 generates a testing signal by a testing mode signal, this testing signal is supplied to a sequencer 15. The sequencer 15 controls so that a transmitting circuit 18 periodically forms a cycle start packet by linking with a cycle timer-monitor 17 on the basis of the testing signal. As a result, the transmitting circuit 18 forms the cycle start packet in synchronism with a system clock SC1k. A signal applied to this formed cycle start packet is outputted outside via a physical layer interface 20.
机译:解决的问题:提供一种具有测试电路的链路层设备,以消除通常的不便之处,即能够通过链路层设备单体来测量AC时序,并能够通过使用常规方法改变温度和电源电压等测量条件来进行测量。目的板。解决方案:当测试电路21通过测试模式信号生成测试信号时,该测试信号将提供给定序器15。定序器15进行控制,以使发送电路18通过与周期计时器链接来周期性地形成周期开始数据包-监控器17根据测试信号。结果,发送电路18与系统时钟SC1k同步地形成周期开始分组。经由物理层接口20将施加到该形成的周期开始分组的信号输出到外部。

著录项

  • 公开/公告号JP4106851B2

    专利类型

  • 公开/公告日2008-06-25

    原文格式PDF

  • 申请/专利权人 セイコーエプソン株式会社;

    申请/专利号JP20000103840

  • 发明设计人 小川 隆央;

    申请日2000-04-05

  • 分类号G01R31/28;G01R31/3183;G06F13/00;H04L25/02;

  • 国家 JP

  • 入库时间 2022-08-21 20:19:42

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