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Cryptographic operation apparatus for AES

机译:AES的密码运算装置

摘要

In a cryptographic operation apparatus, the result of an encryption process, or decryption process, is obtained by disposing two operational circuits (201, 202, 302, 303, 402, 403) in parallel, each comprising four multiplying devices (211 through 214) and an exclusive-OR device (215), and by processing an input data string in two cycles; or by processing an input data string by a single operational circuit (602, 702) in four cycles.
机译:在密码运算装置中,通过并行布置两个运算电路(201、202、302,303、402、403)来获得加密处理或解密处理的结果,每个运算电路包括四个乘法装置(211至214)。异或装置(215),通过两个周期处理输入数据串;或通过单个运算电路(602、702)在四个周期内处理输入数据串。

著录项

  • 公开/公告号EP1933495A3

    专利类型

  • 公开/公告日2009-08-12

    原文格式PDF

  • 申请/专利权人 FUJITSU LIMITED;

    申请/专利号EP20070121899

  • 发明设计人 ITOH KOUICHI;OKADA SOUICHI;

    申请日2007-11-29

  • 分类号H04L9/06;

  • 国家 EP

  • 入库时间 2022-08-21 19:17:12

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