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SYNTHESIS SYSTEM FOR PIPELINED DIGITAL CIRCUITS

机译:流水线数字电路综合系统

摘要

Computer-implemented methods and systems for synthesizing a hardware description for a pipelined datapath for a digital circuit. A transactional datapath specification framework and a transactional design automation system automatically synthesize pipeline implementations. The transactional datapath specification framework captures an abstract datapath, whose execution semantics is interpreted as a sequence of “transactions” where each transaction reads the state values left by the preceding transaction and computes a new set of state values to be seen by the next transaction. The transactional datapath specification framework exposes sufficient information about state accesses that can occur in a datapath, which is necessary for performing precise data hazards analysis, and eventually pipeline synthesis.
机译:用于为数字电路的流水线数据路径综合硬件描述的计算机实现的方法和系统。事务性数据路径规范框架和事务性设计自动化系统会自动综合管道实现。事务性数据路径规范框架捕获了一个抽象数据路径,该路径的执行语义被解释为“事务”序列,其中每个事务读取上一个事务留下的状态值,并计算一组新的状态值,以供下一个事务查看。事务性数据路径规范框架公开了有关可能发生在数据路径中的状态访问的足够信息,这对于执行精确的数据危害分析以及最终进行管道综合是必不可少的。

著录项

  • 公开/公告号US2011307688A1

    专利类型

  • 公开/公告日2011-12-15

    原文格式PDF

  • 申请/专利权人 ERIKO NURVITADHI;JAMES C. HOE;

    申请/专利号US201113158081

  • 发明设计人 ERIKO NURVITADHI;JAMES C. HOE;

    申请日2011-06-10

  • 分类号G06F9/38;

  • 国家 US

  • 入库时间 2022-08-21 17:31:42

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