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Wire spacing verification method, wire spacing verification apparatus, and computer-readable medium

机译:线距验证方法,线距验证装置和计算机可读介质

摘要

A wire-spacing verification method for a computer includes calculating a characteristic impedance of each wire model disposed in a substrate model on a basis of a propagation rate of a signal in the wire model and rise time or fall time of an element model for transmitting the signal, calculating a reference impedance for predetermined sections, creating a distribution map in a direction of a section length with respect to the characteristic impedance of each of the sections for which the reference impedance is calculated, calculating an index indicating a degree of mismatch with the reference impedance, on a basis of the created distribution map, and making an approval/denial determination on the wire model on a basis of the index.
机译:一种用于计算机的线间距验证方法,包括:基于所述线模型中的信号的传播速率和用于传输所述线模型的元件模型的上升时间或下降时间,来计算布置在基板模型中的每个线模型的特征阻抗。信号,计算预定部分的参考阻抗,在相对于要计算参考阻抗的每个部分的特征阻抗的部分长度方向上创建分布图,计算指示与参考阻抗不匹配程度的指标参考参考阻抗,基于创建的分布图,并基于该指标对导线模型进行批准/拒绝确定。

著录项

  • 公开/公告号US8423938B2

    专利类型

  • 公开/公告日2013-04-16

    原文格式PDF

  • 申请/专利权人 DAITA TSUBAMOTO;

    申请/专利号US201113074330

  • 发明设计人 DAITA TSUBAMOTO;

    申请日2011-03-29

  • 分类号G06F17/50;G06F9/455;

  • 国家 US

  • 入库时间 2022-08-21 16:45:29

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