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Establishing clock speed for lengthy or non-compliant HDMI cables

机译:建立长或不兼容的HDMI电缆的时钟速度

摘要

A method whereby the frequency of the clock of an internal bus of a sink of High Definition Multimedia Interface (HDMI) data is reduced, and possibly deep color mode of a sink deactivated, in response to an inability of a source of HDMI data to read extended display identification data (EDID) and/or effect High Definition Content Protection (HDCP) authentication with the sink.
机译:一种响应于HDMI数据源无法读取而降低高清多媒体接口(HDMI)数据接收器的内部总线的时钟频率,并可能禁用接收器的深色模式的方法。扩展显示标识数据(EDID)和/或通过接收器实现高清内容保护(HDCP)身份验证。

著录项

  • 公开/公告号US8984324B2

    专利类型

  • 公开/公告日2015-03-17

    原文格式PDF

  • 申请/专利权人 PETER SHINTANI;

    申请/专利号US201113024498

  • 发明设计人 PETER SHINTANI;

    申请日2011-02-10

  • 分类号G06F1/04;G06F1/12;G06F5/06;G09G5/12;

  • 国家 US

  • 入库时间 2022-08-21 15:19:41

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