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Machine learning based post route path delay estimator from synthesis netlist

机译:来自综合网表的基于机器学习的路由后路径延迟估计器

摘要

A neural network including an embedding layer to receive a gate function vector and an embedding width and alter a shape of the gate function vector by the embedding width, a concatenator to receive a gate feature input vector and concatenate the gate feature input vector with the gate function vector altered by the embedding width, a convolution layer to receive a window size, stride, and output feature size and generate an output convolution vector with a shape based on a length of the gate function vector, the window size of the convolution layer, and the output feature size of the convolution layer, and a fully connected layer to reduce the gate output convolution vector to a final path delay output.
机译:一种神经网络,包括:嵌入层,用于接收门功能向量和嵌入宽度,并通过嵌入宽度改变门功能向量的形状;链接器,用于接收门特征输入向量,并将门特征输入向量与门连接通过嵌入宽度改变的函数向量,卷积层以接收窗口大小,步幅和输出特征大小,并根据门函数向量的长度,卷积层的窗口大小来生成具有形状的输出卷积向量,卷积层的输出特征尺寸,以及将门输出卷积矢量减小到最终路径延迟输出的全连接层。

著录项

  • 公开/公告号US2019325092A1

    专利类型

  • 公开/公告日2019-10-24

    原文格式PDF

  • 申请/专利权人 NVIDIA CORP.;

    申请/专利号US201815960833

  • 发明设计人 MARK REN;BRUCEK KHAILANY;

    申请日2018-04-24

  • 分类号G06F17/50;G06N3/04;G06N3/08;

  • 国家 US

  • 入库时间 2022-08-21 12:11:10

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