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复杂指令集体系结构中的深度优先异常处理方法

摘要

本发明提出了一种复杂指令集体系结构中的深度优先异常处理方法,包括以下步骤:在发生异常时,1)指令重排序缓冲器发出异常信息给受影响的模块,受影响的模块将自身寄存器置为无效,从而刷空流水线;2)译码部件将所述异常信息转换为预先定义的指令;3)译码部件根据所述预先定义的指令,索引只读存储器,找出与之相应的微指令,并将所述微指令送入发射部件;4)发射部件将没有数据相关的微指令送入执行部件执行;5)执行部件执行所述微指令,并将执行结果写入指令重排序缓冲器;6)检查指令重排序缓冲器中的第一条微指令是否异常;7)如果指令重排序缓冲器中的第一条微指令异常,则返回1)流水线刷空步骤;8)如果指令重排序缓冲器中的第一条微指令未发生异常,则指令重排序缓冲器将已经写回的第一条微指令提交,完成处理。

著录项

  • 公开/公告号CN100495324C

    专利类型发明授权

  • 公开/公告日2009-06-03

    原文格式PDF

  • 申请/专利权人 中国科学院计算技术研究所;

    申请/专利号CN200610088939.3

  • 发明设计人 段振中;范东睿;

    申请日2006-07-27

  • 分类号G06F9/38(20060101);

  • 代理机构11021 中科专利商标代理有限责任公司;

  • 代理人朱进桂

  • 地址 100080 北京市海淀区中关村科学院南路6号

  • 入库时间 2022-08-23 09:02:25

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2009-06-03

    授权

    授权

  • 2008-03-19

    实质审查的生效

    实质审查的生效

  • 2008-01-30

    公开

    公开

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