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用于降低DAC中的电容器感应的ISI的方法和设备

摘要

本发明涉及用于降低DAC中的电容器感应的ISI的方法和设备。一种电路可包括多个主数模(DAC)元件,用于将数字输入信号转换成模拟输出信号。控制电路可控制每个主DAC元件以根据数字输入信号而在第一状态和第二状态之间切换从而在输出处提供表示数字输入信号的模拟输出信号。多个校正性DAC元件可被并行地耦接至控制电路和输出之间的多个主DAC元件。多个校正性DAC元件可被控制来减轻由于主DAC元件中的寄生电容导致的码间干扰(ISI)。多个校正性DAC元件可能不向模拟输出信号贡献直流电流。

著录项

  • 公开/公告号CN104579341B

    专利类型发明专利

  • 公开/公告日2018-06-19

    原文格式PDF

  • 申请/专利权人 亚德诺半导体集团;

    申请/专利号CN201410533057.8

  • 发明设计人 S·拉加塞卡;

    申请日2014-10-11

  • 分类号

  • 代理机构中国国际贸易促进委员会专利商标事务所;

  • 代理人郭思宇

  • 地址 百慕大群岛(英)哈密尔顿

  • 入库时间 2022-08-23 10:12:18

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2018-06-19

    授权

    授权

  • 2015-05-27

    实质审查的生效 IPC(主分类):H03M1/10 申请日:20141011

    实质审查的生效

  • 2015-04-29

    公开

    公开

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