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一种防止错锁的延迟锁相环及其锁相方法

摘要

本发明公开一种防止错锁的延迟锁相环及其锁相方法,延迟锁相环包括延迟链、第一鉴相器、逻辑控制电路、反馈电路、固定延时单元和第二鉴相器;输入时钟信号线连接延迟链、第一鉴相器和第二鉴相器;延迟链的输出端连接输出时钟信号线;反馈电路的输入端连接延迟链的输出端,反馈电路的输出端直接连接第一鉴相器,反馈电路的输出端通过固定延迟单元连接第二鉴相器;第一鉴相器和第二鉴相器的输出端连接逻辑控制电路,逻辑控制电路的输出端连接延迟链。本发明能有有效的防止输入时钟错误的锁定在反馈时钟的下降沿。

著录项

  • 公开/公告号CN104702273B

    专利类型发明专利

  • 公开/公告日2018-05-08

    原文格式PDF

  • 申请/专利权人 西安紫光国芯半导体有限公司;

    申请/专利号CN201510134324.9

  • 发明设计人 刘成;郭晓锋;

    申请日2015-03-25

  • 分类号

  • 代理机构西安通大专利代理有限责任公司;

  • 代理人徐文权

  • 地址 710055 陕西省西安市高新6路38号腾飞创新中心A座4层

  • 入库时间 2022-08-23 10:10:54

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2018-05-08

    授权

    授权

  • 2016-06-15

    著录事项变更 IPC(主分类):H03L7/085 变更前: 变更后: 申请日:20150325

    著录事项变更

  • 2015-07-08

    实质审查的生效 IPC(主分类):H03L7/085 申请日:20150325

    实质审查的生效

  • 2015-06-10

    公开

    公开

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