一种箭载计算机处理器与外总线接口余度管理分离的系统

摘要

本发明公开了一种箭载计算机处理器与外总线接口余度管理分离的系统，涉及处理器、内总线接口模块、管理模块和外总线接口。其中，处理器用于完成数据处理；内总线接口模块构建处理器、外总线接口至与管理模块之间的数据通道，实现处理器、外总线接口两者与管理模块的数据交换；管理模块作为余度管理的核心，依据装订的余度管理策略，实现不同内总线接口模块间的数据分发，并实现个别内总线接口模块故障后的功能重构；外总线接口指常规的通信接口。本发明的体系架构设计方法，可实现箭载计算机的处理器与外总线接口的余度管理分离，解除处理器与外总线接口的紧耦合，提高了系统的可靠性，并具有较强的扩展能力。

说明书

技术领域

本发明涉及一种箭载处理器与外总线接口余度管理分离的系统，属于航天器高可靠计算机设计技术领域。 

背景技术

在航空航天领域，各种计算机作为实现功能的硬件载体，要求具备极高的可靠性，目前，高可靠计算机多采用冗余设计架构，计算机内部具备多个处理、接口与总线，计算机通过特定冗余管理策略来进行余度管理。航天器系统与单机设备众多，设备与设备之间接口复杂，目前，在开展航天器计算机设计的过程中，经常会遇到计算机内部包含的处理器与外总线接口数量不一致的情况，例如：计算机内部具备3个处理器，但是为匹配与该计算机互连的另一设备，计算机需要具备4个外总线接口，对于这种情况，3个处理器如何实现同4个外总线接口交互数据将是一个复杂的问题。 

在常规的设计方法中，经常采用的手段是：预先约定某个处理器固定的访问固定的外总线接口，例如，处理器1访问外总线接口1，处理器2访问外总线接口2，处理器3访问外总线接口3和4。采用这种设计方法，系统一经设计好，系统的余度管理策略就已经确定，一旦外总线接口1失效，则对应的处理器1将不能接收/发送数据，可以认定处理器1也同步的失效，这种处理器与外总线接口的绑定式的紧耦合设计使得系统不具有动态重构的能力，无形的降低了系统的可靠性。 

采用如上设计方法，系统余度管理架构已经确定，若希望实现计算机处理器与外总线接口数量的扩展，则需要大规模的修改计算机硬件与软件的设计，系统的功能扩展能力不强。 

发明内容

本发明的技术解决问题的目的在于：针对现有技术的不足，提供了一种箭载处理器与外总线接口余度管理分离的系统，在多个处理器与外总线接口之间增加了管理模块与内总线接口模块，通过管理模块与内总线接口模块实现数据在处理器与外总线接口之间的调度，并根据预先制定的余度管理策略，实现处理器模块、外总线接口模块故障后的动态重构，实现处理器与对外接口的多级余度分离管理，提高了系统的可靠性与可扩展性。 

本发明的技术解决方案是： 

一种箭载处理器与外总线接口余度管理分离的系统包括：n个处理器、n+k个内总线接口模块、管理模块和k个外总线接口； 

处理器用于完成实时数据处理，并将处理的数据通过内总线接口模块和管理模块发送至外总线接口，同时通过内总线接口模块和管理模块接收外总线接口的数据； 

外总线接口将处理器发送的数据按照数据通信协议和电平要求实现转换，并将转换的数据发送出去；同时将接收到的外部数据按照特定的数据通信协议和电平要求实现转换，并将转换数据通过内总线接口模块和管理模块发送至处理器； 

内总线接口模块与处理器、外总线接口一一对应；内总线接口模块接收处理器或外总线接口发送的数据，并将该数据进行处理，在该数据的前端添加与处理器或外总线接口对应内总线接口模块的地址，并将处理后的数据发送至管理模块；内总线接口模块接收管理模块发送的数据，并将该数据前端的内总线接口模块的地址去除，然后发送至与内总线接口模块对应的处理器或外总线接口；内总线接口模块将数据是否成功发送至处理器或外总线接口的信息反馈至管理模块(内总线接口模块作为CPU处理模块/外总线接口模块与管理模块之间的“管道”，实现CPU模块、外总线接口模块两者与管理模块的数据交换，内总线接口模块与CPU模块/外总线接口模块一一绑定，两者通过数据线、时钟信号相连接，当CPU模块/外总线接口模块准备发起数据传输时，片选信号有效， 内总线接口模块将数据译码传输至管理模块)； 

管理模块为内总线接口模块分配不同的地址(该地址就是内总线模块添加到数据前端的地址)；管理模块将与处理器或外总线接口对应的内总线模块发送的数据进行缓存，并根据管理模块的余度管理策略以及接收到的数据前端的地址将数据发送至与外总线接口或处理器对应的内总线接口模块；管理模块根据内总线接口模块反馈的信息判定数据是否发送成功，并根据是否发送成功确定是否向备用外总线接口重新发送数据(管理模块实现对于内总线接口模块的管理，管理单元通过识别内总线接口模块的数据来源地址与目的地址，实现数据的路由与分发，管理模块作为余度管理的核心，依据装订的余度管理策略，实现多个数据源的交叉访问，实现通信链路故障后的功能重构等)。 

所述管理模块包括缓存模块、路由模块、余度策略管理模块、地址分配模块； 

缓存模块根据内总线接口模块的数量以及总线接口模块承载的数据量大小划分容量不等的缓存区，并将该缓存区与相应内总线接口模块一一对应；缓存模块将接收到的内总线接口模块发送的数据放置于相应的缓存区； 

路由模块实时查询缓存模块不同缓存区是否有待发送的数据，并读取缓存区存储的数据，根据读取数据的前端地址查询余度策略管理模块存储的该数据对应地址的余度管理策略；路由模块根据余度管理策略将读取的数据发送至相应的内总线接口模块，并接收内总线接口模块反馈的数据是否成功发送至对应的处理器或外总线接口的信息；路由模块根据内总线接口模块反馈的信息判断数据是否发送成功，若数据发送不成功，路由模块向该内总线接口模块以一定时间间隔重复一定次数发送该数据，若仍未成功，则查询余度策略管理模块中的下一级余度管理策略，选择备份内总线接口模块进行数据重新发送，直到成功； 

余度策略管理模块存储预先设定的多级余度管理策略；多级余度管理策略以多级策略树形式存在，路由单元依据该策略树实现向对应的内总线接口模块 发送数据； 

地址分配模块为内总线接口模块分配地址。 

所述的内总线接口模块包括串并转换模块、并串转换模块、绑定地址处理模块，解除地址处理模块； 

串并转换模块将接收到的处理器或外总线接口发送的数据进行串并转换，并将其发送至绑定地址处理模块； 

绑定地址处理模块在接收到的数据的前端添加若干字节的地址，地址与该内总线接口模块的地址相对应，并将处理完的数据存入管理模块的缓存模块； 

解除地址处理模块接收路由模块发送的数据，并将位于数据前端的地址解除，将解除后的数据送入并串转换模块； 

并串转换模块将接收到的数据发送至相应的外总线接口或处理器，并将数据是否成功发送至对应的处理器或外总线接口的信息反馈至管理模块的路由模块。 

所述处理器采用CPU、DSP和单片机用于完成箭载电气设备核心的数据处理功能。 

所述外总线接口采用特定通信接口RS422，1553B。 

本发明与现有技术相比具有如下优点： 

(1)本发明采用在处理器与外总线接口之间增加了管理模块与内总线接口模块，通过管理模块与内总线接口模块实现对于多个处理器与外总线接口之间数据的调度与管理，对于处理器与外总线接口数量不一致的情况可实现灵活调度，通过管理模块中的余度管理策略，可以实现在某个处理器或外总线接口故障后，系统可自动降级重构，解除了处理器与外总线接口的紧耦合设计，提高了系统设计的灵活性与可靠性； 

(2)本发明中处理器与外总线接口之间没有直接的硬件连接关系，仅与实现内总线接口模块与管理模块的FPGA相连接，当需要扩展处理器或外总线接口数量时，不需要改动原有处理器、外总线接口的硬件连接，只需要将新增的 处理器与外总线接口连接至实现内总线接口模块与管理模块的FPGA，同时修改FPGA软件，为新增的内总线接口模块分配地址，并修改余度管理策略，即可实现功能的扩展，有效降低了功能扩展的难度。 

附图说明

图1为本发明系统结构图； 

图2为本发明管理模块示意图； 

图3为本发明内总线接口模块示意图； 

图4为本发明实施例结构图； 

图5为本发明余度策略管理图。 

具体实施方式

下面结合附图对本发明具体实施方式做进一步介绍。 

如图1所示，一种箭载计算机处理器与外总线接口余度管理分离的系统包括：n个处理器、n+k个内总线接口模块、管理模块和k个外总线接口。 

本发明的系统中，处理器用于完成实时数据处理，可以采用CPU、DSP和单片机等常规处理器；外总线接口模块实现特定通信协议或电平的接口，例如RS422，1553B等。处理器和外总线接口的数量可以不相等。处理器需要接收外总线接口的数据，并可以将数据通过外总线接口发送出去。 

本发明中的管理模块和内总线接口模块采用FPGA实现；处理器和外总线接口均与FPGA相连接，每个处理器和外总线接口与FPGA具体的连接信号包括同步串行时钟信号与数据信号。 

系统上电后，管理模块为每个内总线接口模块分配对应的地址，以区别不同的内总线接口模块，同时根据该地址，为每个内总线接口模块在管理模块中的缓存模块中配置对应的缓存区(每个缓存区的容量大小根据内总线接口模块对应的处理器或外总线接口的通信数据量确定)。 

管理模块 

如图2所示，管理模块包括缓存模块、路由模块、余度策略管理模块、地 址分配模块。 

缓存模块在FPGA中以若干个例化的双口RAM实现，每个双口RAM作为一个缓存区，与一个内总线接口模块相对应，因此，双口RAM的数量与内总线接口模块的数量是一致的。每个双口RAM的容量根据内总线接口模块的承载的数据量确定。缓存模块根据内总线接口模块的数量以及总线接口模块承载的数据量大小划分容量不等的缓存区，并将该缓存区与相应内总线接口模块一一对应；缓存模块将接收到的内总线接口模块发送的数据放置于相应的缓存区。 

路由模块实时查询缓存模块多个双口RAM的数据是否有更新的标识，若标识有效，则表示该双口RAM对应的内总线接口模块有待发送的数据，路由模块读取有待发送数据的双口RAM中的数据，并识别RAM首地址中存储的数据，该数据对应的是发送数据的内总线接口模块的地址，路由模块根据该地址查询余度策略管理模块存储的余度策略管理表，读取第1行第i列的数据(i为双口RAM首地址存储的数据)，读取处的数据即为需要将该双口RAM中的数据发送的目标内总线接口模块的地址，路由模块将RAM中的数据发送至与该地址对应的内总线接口模块。路由模块完成发送后，查询内总线接口模块反馈的数据是否成功发送至对应的处理器或外总线接口的标识。若数据发送不成功，路由模块向该内总线接口模块以一定时间间隔重复一定次数发送该数据，若仍未成功，则查询余度策略管理模块中的下一级余度管理策略，选择备份内总线接口模块进行数据重新发送，直到成功。 

余度策略管理模块存储预先设定的多级余度管理策略，多级余度管理策略以多级策略树形式存在，路由单元依据该策略树实现向对应的内总线接口模块发送数据。 

地址分配模块为内总线接口模块分配地址。 

内总线接口模块 

如图3所示，内总线接口模块包括串并转换模块、并串转换模块、绑定地址处理模块，解除地址处理模块。 

在内总线接口模块接收处理器或外总线接口发送的数据时，处理器或外总线接口将时钟与数据同步发送，串并转换模块按时钟节拍同步采样数据，将采样得到的数据进行串并转换，并将其发送至绑定地址处理模块。 

绑定地址处理模块在接收到的数据的前端添加一个地址，该地址就是发送数据的内总线接口模块的地址，并将处理完的数据存入管理模块的缓存模块。 

在内总线接口模块接收路由模块发送的数据时，首先由解除地址处理模块去除数据前端的首地址，将去除地址后的数据送入并串转换模块。 

并串转换模块同步产生时钟，将接收到的数据与时钟同步发送至相应的外总线接口或处理器，并依据通信协议将数据是否成功发送至对应的处理器或外总线接口的信息反馈至管理模块的路由模块。 

下面以一个具体实施例对本发明的具体工作过程和工作原理做进一步解释和说明： 

如图4所示，本实施例中的处理器采用DSP处理板(包含一片DSP与一片FPGA)，个数为3个，外线接口采用RS422控制板(包含一片FPGA与一片26C31)，个数为4个；管理模块和内总线接口模块采用FPGA实现。管理模块为3个DSP处理板分别分配地址为1、2、3，为4个RS422控制板分配的地址为4、5、6、7。本实施例的余度管理策略如图5所示，为简化说明，仅列出了2级余度管理策略。在初始状态，系统按照级别1的余度管理策略通信，即：DSP处理板1与RS422控制板1交换数据(如图5所示，即分配地址1对应着分配地址4)，DSP处理板2与RS422控制板2交换数据(如图5所示，即分配地址2对应着分配地址5)，DSP处理板3与RS422控制板3交换数据(如图5所示，即分配地址3对应着分配地址6)，第4个RS422控制板作为备份。 

若RS422控制板1出现故障，即地址4发生故障，则依据图5中余度管理策略，系统访问策略修改为：选择地址4故障的分支，DSP处理板1与RS422控制板4交换数据(如图5所示，即分配地址1对应着分配地址7)，DSP处理 板2与RS422控制板2交换数据(如图5所示，即分配地址2对应着分配地址5)，DSP处理板3与RS422控制板3交换数据(如图5所示，即分配地址3对应着分配地址6)，实现系统的动态自动重构。 

本发明未详细说明部分属本领域技术人员公知常识。