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Analyzing the DDR SIMULATION RESULTS

机译:分析DDR仿真结果

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摘要

In the last two articles (June 2016 and July 2016, respectively), we discussed critical signal integrity concerns that engineers face designing the DDR bus, and points to consider while setting up the simulation. We covered how understanding the requirements, and then simulating correctly, increases the odds the board will be functional from the start. This results in reducing the number of spins required for the design, while shortening the time to release. In this third part of the series, we bring the first two parts together by discussing what to look for in the results of the simulation.
机译:在前两篇文章(分别为2016年6月和2016年7月)中,我们讨论了工程师在设计DDR总线时面临的关键信号完整性问题,并讨论了设置仿真时应考虑的要点。我们介绍了如何理解需求,然后正确地进行仿真,如何增加电路板从一开始就可以工作的几率。这样可以减少设计所需的旋转次数,同时缩短释放时间。在本系列的第三部分中,我们通过讨论在模拟结果中查找的内容将前两个部分放在一起。

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