机译:自下而上的基于层次的VLSI布局设计中的成本降低
Department of Electrical Engineering, University of Malaya, Lembah Pantai, 50603 Kuala Lumpur, Malaysia;
Department of Electrical Engineering, University of Malaya, Lembah Pantai, 50603 Kuala Lumpur, Malaysia;
Department of Electrical Engineering, University of Malaya, Lembah Pantai, 50603 Kuala Lumpur, Malaysia;
VLSI physical design; layout generation; floorplanning; bottom-up hierarchy; cost reduction;
机译:考虑降低峰值温度的用于VLSI布局规划的云计算
机译:VLSI设计中基于线性规划的布局规划算法
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