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机译:电路,布局和光刻的协同优化,以实现超出光栅的预测技术扩展
PDF Solutions, Pittsburgh, PA, USA;
Application-specific integrated circuits; complementary metal-oxide-semiconductor (CMOS) integrated circuits; design automation; design for manufacturability; integrated circuit economics; lithography;
机译:深亚微米模拟电路的性能驱动电路和布局共同优化
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机译:混合电子束和多图案光刻技术的布局分解协同优化
机译:CMOS锁存电路中软错误的布局依赖性及其对65 nm及以后工艺节点的缩放趋势的综合研究
机译:高度缩放CMOS和硅锗BICMOS技术的装置和电路可靠性预测建模
机译:用于超大规模技术节点的基于2D材料的FET的材料-设备-电路共同优化
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