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机译:使用亚微米技术的10tfull加法器的功率最小化和使用绝热逻辑的Pfalfull加法器的功率最小化
机译:基于低功耗和区域高效的半加法器选择加法器设计使用常见的布尔逻辑进行处理元素
机译:使用脚形二极管Domino Logic的低功耗动态逻辑纹波载波加法器
机译:利用静态CMOS逻辑和绝热逻辑的低功耗8位超前进位加法器的设计与实现
机译:最大限度地降低SOI中的次要影响:32位ANT逻辑加法器实现
机译:使用推测性Han-Carlson并行前缀加法器实现的高速进位跳过加法器。
机译:面积/延迟优化的早期输出异步全加法器和相对定时的纹波进位加法器
机译:利用静态CMOS逻辑和绝热逻辑的低功耗8位超前进位加法器的设计与实现