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基于FPGA的32位浮点FFT处理器的设计

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摘要

介绍了一种基于FPGA的1024点32位浮点FFT处理器的设计.采用改进的蝶形运算单元,减小了系统的硬件消耗,改善了系统的性能.详细讨论了32位浮点加法器/减法器、乘法器的分级流水技术,提高了系统性能.浮点算法的采用使得系统具有较高的处理精度.

著录项

来源
《电讯技术》 |2003年第6期|73-77|共5页
作者
赵忠武; 陈禾; 韩月秋;
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作者单位

北京理工大学,电子工程系,北京,100081;

北京理工大学,电子工程系,北京,100081;

北京理工大学,电子工程系,北京,100081;

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原文格式 PDF
正文语种 chi
中图分类信号处理;
关键词
数字信号处理; 快速傅里叶变换; 浮点加法器/减法器; 浮点乘法器; 分级流水; 可编程门阵列; 设计;

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