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刘柯;
西安邮电大学自动化学院,陕西西安710121;
多核处理器; Cache; 一致性; 命中率;
机译:V-SET CACHE:多核处理器的有效自适应共享CACHE
机译:DASC-DIR:适用于多核处理器的低开销一致性目录
机译:DP&TB:用于多核芯片多处理器的一致性过滤协议
机译:一种具有D-Cache的新型多处理器混合缓存一致性协议
机译:多核处理器的缓存一致性技术
机译:用于多尺度/类型分类的多核对象检测协处理器适用于IOT设备
机译:适用于许多核心处理器的可扩展缓存一致性协议,具有针对地址的共享地址空间,以降低功耗。
机译:可伸缩多处理器中Cache-miss-Initiated预取技术的初步评估。
机译:在多处理器计算机系统中确保CACHE存储器的多个和主要存储器之间的数据一致性的改进方案
机译:在多处理器计算机系统中确保多个CACHE存储器与主存储器之间数据一致性的改进方案
机译:用于网络节点的CACHE一致性控制系统允许CPU或I / O设备访问目标块而无需CACHE一致性控制,如果关联节点的访问权限在目标块的访问权限中
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