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袁文; 王凌燕; 刘明; 徐涛; 王江山;
江西师范大学物理与通信电子学院 江西南昌 330022;
集成逻辑门; CMOS逻辑电路; 并与; 串或;
机译:适用于采用低压BiCMOS技术的VLSI的1.5 V全摆幅BiCMOS动态逻辑门电路
机译:具有减小的输入电容的静态CMOS对逻辑门电路
机译:使用两阶段Wlotc / Blotc标签 - 比较方案和感测字符串/位线(SWL / SBL)标签意义的0.8V,128K,40MO,40MO,四级,设定关联,2级CMOS缓存内存,2级CMOS缓存内存AMPS中的8-T标签单元2级和10-T缩小逻辑挥杆
机译:阈值逻辑属性和方法:在CMOS后设计自动化和基因调控建模中的应用。
机译:具有列并行12位SAR ADC的低噪声CMOS图像传感器的快速多重采样方法
机译:CMOS逻辑IC输出波形失真的存在机制及改进方法
机译:批量CmOs VLsI技术研究。第1部分:可扩展CmOs设计规则。第2部分pLa(可编程逻辑阵列)设计的CmOs方法
机译:CMOS电路系统具有用于提供指定逻辑功能的输出信号的逻辑门电路,并且逻辑门电路具有多个场效应晶体管
机译:CMOS技术中使用的快速,低功耗和ECL(EMITTER耦合逻辑)兼容的输出电路
机译:具有快速输出电压下降特性的BiCMOS逻辑电路
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