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基于对偶基的比特并行算法实现RS编码

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摘要

以DVB-C系统中的RS编码为例,参照Berlekamp比特串行乘法器,提出了一种基于对偶基的比特并行乘法器的方法来实现RS编码器,可以达到较高的吞吐率,从而可以采用FPGA/CPLD实现高速RS编码.

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来源
《中国传媒大学学报（自然科学版）》 |2005年第1期|43-48|共6页
作者
刘昌银;
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作者单位

中国传媒大学,通信工程系,北京,100024;

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正文语种 chi
中图分类数据传输技术;
关键词
RS编码; 有限域乘法器; 对偶基; 比特并行; FPGA;

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