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晏巍; 王奕; 李仁发;
湖南大学嵌入式系统与网络实验室,长沙410082;
湖南大学信息科学与工程学院,长沙410082;
湖南大学网络与信息安全湖南省重点实验室,长沙410082;
高级加密标准(AES); 错误检测; GF(24)域; FPGA;
机译:AES-128密码:最小面积,低成本FPGA实现
机译:AES-128 CIPHER。最小面积,低成本FPGA实现
机译:带有在线错误检测功能的紧凑型AES内核,适用于具有少量硬件资源的FPGA应用
机译:使用FPGA的嵌入式存储器模块实现的FSM的低成本并发错误检测
机译:128位AES算法的低功率FPGA实现
机译:通过合并和解决方案内杂交实现高效低成本的种群重测序
机译:高效实现TLSv1.2协议的低成本SOC-FPGA与ECC_AES支持安全的物联网协调员
机译:大曲率圆轨迹模式识别方案及基于散列分类器的FpGa实现
机译:通过并发多帧配置方案实现高速FPGA启动
机译:基于闪存的SSDS的耐久性感知RAID方案,具有FPGA优化的实现
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