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提高ASIC验证的速度与可视性基于FPGA的ASIC/SoC原型设计及基于FPGA的系统在实时硬件速度下可以实现100的内部信号可视性

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@@ 前言rn高性能、高容量FPGA在ASIC/SoC原型设计及系统两方面的应用持续增长.这些设计通常包括硬件及嵌入式软件(也可能包括应用软件)的复杂组合,这给系统验证带来了巨大负担,原因是检测、隔离、调试及校正故障要比最初设计所花费的时间、资金和工程资源多得多.

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来源
《今日电子》 |2007年第6期|58-61|共4页
作者
Mario Larouche;
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作者单位

Synplicity公司;

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正文语种 chi
中图分类计算技术、计算机技术;
关键词

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