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任子亭;
贺州学院计算机科学与工程系;
嵌入式CPU; 数学运算库; FPGA; IP核; Verilog语言;
机译:基于吠陀数学的高速32位流水线乘法器的FPGA设计,仿真和原型设计
机译:基于FPGA和UDP / IP协议栈的千兆以太网IP核的研究与实现
机译:基于四个32位并行运算的128位AES算法的FPGA实现
机译:基于CMOS兼容光子VLSI器件技术的32 x 32位数据库过滤器芯片的设计和分析
机译:基于数学形态学运算的自适应方法对多孔生物陶瓷进行微计算机断层扫描和SEM研究
机译:基于FpGa的32位浮点运算单元的设计及其VHDL代码的maTLaB验证
机译:关系代数运算符与基于CODasYL的数据库之间的运算符映射由CODasYL DBms管理
机译:接口总线协议,用于管理分布式微处理器接口系统中的事务,该接口与基于marco-cell的设计实现为ASIC或FPGA面包板
机译:分布式微处理器系统与基于宏单元的设计相接口,该设计实现为ASIC或FPGA面包板以及相关的通用总线协议
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