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雷瑾亮; 陈洪美; 王爱华;
中国科学院微电子研究所;
国家科技部高技术研究发展中心;
北京理工大学信息与电子学院;
准循环LDPC码; 低时延译码; FPGA实现; 流水线;
机译:基于FPGA的准循环LDPC码解码器实现的存储系统优化
机译:基于里德-所罗门的准循环LDPC码:设计,周长,循环结构和短循环的减少
机译:准循环LDPC码的低复杂度高速解码器设计
机译:基于低存储器FPGA的用于准循环LDPC码的LDPC解码器架构
机译:基于网格的准循环LDPC卷积码可实现节能解码器
机译:实时安全/不安全视频时延测量/分析基于FPGA的线内安全性
机译:基于多天线的长码异步Ds / CDma系统的时延估计
机译:基于准循环LDPC块码的时变周期LDPC卷积码的自适应编码
机译:基于里德-梭罗的准循环LDPC码的打孔,编码/解码方法和存储装置的设计方法
机译:基于超几何平面平行丛的多速率准循环LDPC(多速率准循环低密度奇偶校验码)生成方法及其装置
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