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任雪倩; 李金城; 赵建中; 张锋;
中国科学院微电子研究所智能感知研发中心;
北京交通大学电子信息工程学院;
buffer; RapidIO; 流量控制;
机译:新的GUI缩短了串行RapidIO系统设计的上市时间
机译:基于多核DSP和串行RapidIO互连的大规模并行机上脉冲多普勒雷达信号处理链的实时并行实现
机译:基于量子点蜂窝自动机纳米技术的串行输入串行输出(SISO)和并联输入并联输出(PIPO)移位寄存器的优化设计
机译:RapidIO中的串行物理层设计
机译:基于任务描述的串行机器人操纵器的目标导向设计。
机译:基于偏振独立设计的基于两端口连接层的夹层光栅
机译:基于暂定极限状态设计标准设计的2层砌体墙框架抗震性能研究
机译:用于串行总线物理层和连接层的处理器具有采用改进的微制造技术的两个芯片集成设计
机译:一种基于新型NAND的混合NVM设计,该设计将具有串行接口的1-Die进行NAND和NOR集成
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