多位数字delta-sigma调制器的设计

摘要

本文介绍了一个高信噪比的、用在24位44.1kHz采样率的音频数/模转换器(DAC)中的4阶15级量化的delta-sigma调制器(DSM)。在设计中,为了减少量化噪声,选用了奇数个量化等级;为了提高动态范围(DR),在设计噪声传输函数(NTF)时对零点进行优化,通过这些方法降低量化噪声和时钟抖动的影响。这个DSM的峰值信噪比(SNR)可以达到130dB以上,满足0.35μmCMOS工艺设计的音频DAC的系统要求。本文给出了这个DSM的MATLAB仿真模型及仿真结果,并在此基础上给出了电路实现结构。