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基于100Gbps光传输网络的RS(255,239)译码器设计

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摘要

本文就基于100Gbps光传输网络的RS(255,239)译码问题,给出了一种并行译码的电路实现设计方案.该设计方案在充分考虑100Gbps光传输网络中的高速时钟需求的同时,也尽量考虑了将硬件逻辑资源的消耗降低.文中最后给出了仿真及FPGA综合结果.

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来源
《中国集成电路》 |2015年第11期|20-24,32|共6页
作者
饶清文; 胡烽; 朱齐雄;
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作者单位

烽火通信科技股份有限公司,湖北武汉,430205;

烽火通信科技股份有限公司,湖北武汉,430205;

烽火通信科技股份有限公司,湖北武汉,430205;

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原文格式 PDF
正文语种 chi
中图分类
关键词
100Gbps光传输网络; RS(255,239); 并行译码; 高速时钟;

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