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魏军; 杨秀芝;
福州大学数字电视工程研究中心;
IDEA算法; 基于FPGA; 加解密算法; 加密技术;
机译:基于FPGA的AES加解密系统的硬件实现
机译:使用FPGA和Handel-C的IDEA算法的动态和部分可重新配置的实现
机译:基于FPGA的加解密算法的实现
机译:基于支持向量机分类的超声探伤算法的FPGA实现。
机译:基于模型的设计浮点累加器。研究案例:支持向量机内核功能的FPGA实现
机译:基于基于基于基于基于基于基于基于基于速率的CORDIC算法,FPGA实现超声S扫描坐标转换
机译:基于FpGa的高效集群检测算法实现时间投影室偏振计中的条带检测器读出系统。
机译:基于块的FBLMS算法的基于浮动点的FPGA实现装置和方法
机译:实现sms4加密算法的加解密处理方法及系统
机译:一种实现sms4算法的高效加解密处理方法
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