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低功耗双边沿触发器的逻辑设计

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本文从消除时钟信号冗余跳变而致的无效功耗的要求出发，提出双边沿触发器的设计思想与基于与非门的逻辑设计．用ＰＳＰＩＣＥ程序模拟证实了该种触发器具有正确的逻辑功能，能够正常地应用于时序电路的设计，并且由于时钟工作频率减半而导致系统功耗的明显降低．

著录项

来源
《电子学报》 |1999年第5期|129-131|共3页
作者
吴训威; 韦健;
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作者单位

浙江大学电子工程系;

美国南加州大学电气工程系统系;

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原文格式 PDF
正文语种 chi
中图分类 TN783.02;
关键词
低功耗; 触发器; 逻辑设计; 集成电路;

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