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多通道高速HDLC处理器的设计与实现

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摘要

本文详述了由一个具有分时处理能力的HDLC处理器对128逻辑通道数据进行高速、并行、实时处理的设计与实现过程,并讨论了其实现关键技术,给出了系统中关键结点的功能仿真波形图.

著录项

来源
《电子学报》 |2003年第11期|1630-1633|共4页
作者
陆园琳; 乔庐峰; 王志功;
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作者单位

东南大学射频与光电集成电路研究所,江苏南京,210096;

东南大学射频与光电集成电路研究所,江苏南京,210096;

东南大学射频与光电集成电路研究所,江苏南京,210096;

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原文格式 PDF
正文语种 chi
中图分类微处理机;
关键词
高级数据链路控制规程; 通信协议; 时分复用; 现场可编程门阵列;

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