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刘祥远; 陈书明;
国防科技大学计算机学院,湖南长沙,410073;
先进先出; 高性能; 格雷码; 异步; 同步器;
机译:一种异步FIFO的VHDL实现
机译:同步FIFO模块和简单异步FIFO模块的设计示例
机译:用于同步和异步通信的可重新配置的FIFO存储器电路
机译:一种新型的混合FIFO异步时钟域交叉接口方法
机译:使用异步FIFO作为弹性元素的多时钟域总线体系结构。
机译:通过结构优化和阻尼机理揭示一种稳定高性能的受阻酚/聚合物基阻尼材料
机译:使用Verilog HDL设计与验证异步FIFO的异步FIFO
机译:一种设计语言模块化异步控制结构。
机译:一种用于使异步传输的空闲运行条件和接收fifo的fifo的溢出条件最小化的方法和装置
机译:一种用于使异步传输的空闲运行状况和接收fifo的fifo的溢出状况最小化的方法和装置
机译:异步FIFO控制器和防止异步FIFO缓冲区数据溢出的方法
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