声明
致谢
摘要
第一章 绪论
1.1 研究背景和意义
1.2 国内外研究现状
1.3 本课题研究内容来源和结构安排
第二章 三维SoC的测试
2.1 可测试性设计
2.1.1 通用扫描设计
2.1.2 内建自测试
2.1.3 边界扫描测试
2.1.4 SoC的测试
2.2 三维集成电路简介
2.2.1 三维集成电路制造过程
2.2.2 三维集成电路的挑战
2.2.3 三维集成电路的测试流程
2.2.4 三维与二维集成电路测试的区别
2.3 三维SoC的测试
2.3.1 三维TAM与二维TAM的不同
2.3.2 三维测试外壳和二维测试外壳的不同
2.3.3 三维SOC的测试时间
2.3.4 三维SoC的测试方法
2.4 本章小结
第三章 在TSVs和测试衬垫数量限制下的三维测试外壳的优化方法
3.1 问题描述
3.2 具体算法
3.3 总体流程
3.3.1 待分配的扫描链小于绑定后测试外壳扫描链数量
3.3.2 待分配的扫描链大于等于绑定后测试外壳扫描链数量
3.4 实验
3.5 结论
第四章 在TSVs数量限制下三维测试外壳优化方法
4.1 问题定义
4.2 BGA算法流程
4.2.1 BFD算法优化绑定前的测试外壳扫描链
4.2.2 遗传算法优化绑定后的测试外壳扫描链
4.3 实验及结果
4.4 结论
第五章 三维IP核绑定前后总测试时间的优化
5.1 问题描述
5.2 本文方法
5.2.1 优化绑定后的测试时间
5.2.2 优化绑定前的测试时间
5.3 实验与结果
5.4 结论
第六章 总结和展望
6.1 总结
6.2 展望
参考文献
攻读硕士学位期间的学术活动及成果情况
合肥工业大学;