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独创性声明和关于论文使用授权的说明
第一章概论
1.1大规模集成电路的设计流程
1.2后端设计流程
1.3 SOC和IP复用
第二章标准单元法VLSI设计
2.1标准单元设计方法概述
2.2自动抽象版图生成
2.3逻辑综合
2.3.1逻辑综合工具Build Gates介绍
2.3.2 Build Gates功能
2.4深亚微米自动布局布线
2.4.1深亚微米自动布局布线(SE_DSM)介绍
2.4.2 SE_DSM设计流程
2.4.3 SE_DSM具体步骤
2.5静态时序分析
2.5.1静态时序分析器( Pearl)的介绍
2.5.2 Pearl的功能
2.6数字功放的投片验证
2.6.1数字功放研究的现状和意义
2.6.2数字功放的研究内容
2.6.3数字功放的后端设计
第三章硬IP核复用的研究
3.1硬IP核复用的方法
3.1.1硬核IP复用及自动布局布线的传统流程
3.1.2硬核IP复用及自动布局布线的新流程
3.1.3层次式的硬核IP复用方法
3.2 ICC和DFII简介
3.2.1 ICC的设计流程
3.2.2 ICC和DFII的使用方法
3.2.3准备数据
3.2.4数据的类型及表达定义
3.3建立自主单元库
3.3.1建库流程
3.3.2 C9794sch电路
3.3.3自主建立单元库
3.3.4调用模块
3.4自动布局布线
3.4.1布局
3.4.2规则文件的定义
3.4.3 ICC布线
3.5 DRC
3.6设计实例与实验结果
3.6.1层次式划分结构重组
3.6.2顶层互连线的生成
3.6.3试验总结
第四章80C51IP核的设计
4.1 80C51的FPGA的设计
4.1.1 80C51的概述
4.1.2存储区结构
4.1.3位操作和布尔逻辑
4.1.4寻址方式
4.1.5处理器状态
4.1.6电源控制
4.1.7中断系统
4.1.8内置定时/计数器
4.1.9内置UART
4.1.10其他功能
4.1.11设计
4.1.12实现
4.2 80C51的FPGA的验证
4.2.1 80C51的总体的框图
4.2.2设计的限制
4.2.3 FPGA的实现
4.2.4综合统计表
4.2.5测试文件
4.3 80C51的物理设计
第五章总结
附录1
附录2
附录3
附录4
参考文献
致谢