CEI - Centro de Electronica Industrial Departamento de Automatica, Ingenieria Electronica e Informatica Industrial Universidad Politecnica de Madrid (UPM). C/ Jose Gutierrez Abascal, 2, 28006, Madrid, Spain;
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system on chip; algorithm acceleration; FPGAs; profiling; reconfigurable systems; partial reconfiguration;
机译:基于步骤卷积分解方法,用于拉伸CNN加速算法,以实现高效且灵活的硬件实现
机译:具有硬件加速功能的DSP实时转码高清
机译:多媒体迭代算法并行硬件实现的设计方法
机译:运行时间硬件代码分析的方法,用于算法加速度
机译:通用硬件和统一硬件加速架构的自适应AI算法
机译:具有图形硬件加速的改进脂肪/水重建算法
机译:用于算法加速的运行时硬件代码配置文件的方法
机译:用于DNa码字搜索的多重遗传算法的硬件加速。