Low power design; FPGA; AES; Security;
机译:FPGA的高度可扩展AES算法的FPGA实现,采用改进的混合列和门替换技术,用于TCP / IP中的安全性应用
机译:将减少的09、0B,0D和0E结构合并为用于AES-128技术的反向混合列
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机译:AES混合列/逆混合列的低功耗实现在FPGA上
机译:气泡和浆料气泡塔反应器:*混合,流态转换和放大
机译:用于基于频率混合的多重磁免疫检测的3D打印模块化免疫过滤柱
机译:浅层混合层加固深混合柱失效的数值分析
机译:高分散和低连续体积流量下脉冲板柱的工作范围,滞留,液滴尺寸和轴向混合